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【2h】

Combining Multipath and Single-Path Time-Interleaved Delta-Sigma Modulators

机译：结合多径和单路时间交错Delta-sigma调制器

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作者
Ahmed Gharbiya; David A. Johns;
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年度 2010
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1. Combining Multipath and Single-Path Time-Interleaved Delta-Sigma Modulators [J] . Gharbiya A., Johns D. A. IEEE transactions on circuits and systems. II, Express briefs . 2008,第12期

机译：结合多路径和单路径时间交错的Delta-Sigma调制器
2. Analysis and Design of a 20-MHz Bandwidth Continuous-Time Delta-Sigma Modulator With Time-Interleaved Virtual-Ground-Switched FIR Feedback [J] . Baluni Alok, Pavan Shanthi IEEE Journal of Solid-State Circuits . 2021,第3期

机译：具有时间交织虚拟地面切换冷杉反馈的20MHz带宽连续时间δ-Sigma调制器的分析与设计
3. Noise-Coupled Time-Interleaved Delta-Sigma Modulator with Reduced Hardware Complexity [J] . Abdoli Mahmud, Aghdam Esmaeil Najafi Journal of circuits, systems and computers . 2021,第4期

机译：具有减少硬件复杂性的噪声耦合时间交错的Δ-Sigma调制器
4. A 71. 4dB SNDR 30MHz BW Continuous-Time Delta-sigma Modulator Using a Time-Interleaved Noise-Shaping Quantizer in 12-nm CMOS [C] . Chan-Hsiang Weng, Tzu-An Wei, Hung-Yi Hsieh, Symposium on VLSI Circuits . 2019

机译：一个71. 4dB SNDR 30MHz BW连续时间Delta-sigma调制器，在12nm CMOS中使用时间交错的噪声整形量化器
5. Design and implementation of time-interleaved delta-sigma A/D converters. [D] . Lim, Lysander B. 1994

机译：时间交错的delta-sigma A / D转换器的设计和实现。
6. A 100-Mhz Bandwidth 80-dB Dynamic Range Continuous-Time Delta-Sigma Modulator with a 2.4-Ghz Clock Rate [O] . Yao Xiao, Zhifei Lu, Zhaofeng Ren, 2020

机译：具有2.4Ghz时钟速率的100Mhz带宽80dB动态范围连续时间Δ-Σ调制器
7. Design and Simulation of a 3rd-order Discrete-Time Time-Interleaved Delta-Sigma Modulator with Shared Integrators between Two Paths [O] . Talebzadeh J., Kale I. 2017

机译：具有两个路径之间共享积分器的三阶离散时间交错Delta-Sigma调制器的设计和仿真

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